Design and realisation of Low leakage 1-bit CMOS based Full Adder Cells for Mobile Applications

برای اکثر مقیاس های ابزار های cmos (مثلا 180nm) اتلاف توان نشتی برای طراحان مدارات VLSI یک مساله مهم شده است.با مقیاس بندی شدن تکنولوژی در رژیم های نانومتری توان اتلافی نشتی ومصونیت نویز استاندارد های مهمی در مقایسه با توان اکتیو، تاخیر و مساحت می باشند.در این پروژه سلول تمام جمع کننده با نشتی پایین برای ادوات سیار طراحی شده است. در سالیان اخیر    نمونه های مختلفی از گیت های منطقی مختلف برای پیاده سازی سلول جمع کننده...